岗位描述
岗位职责
1、负责FPGA逻辑架构设计、RTL编码、功能仿真与时序收敛;
2、优化逻辑资源利用率与关键路径时序,确保系统稳定可靠;
3、配合软硬件团队完成板级联调与系统集成验证;
4、输出FPGA设计文档、仿真报告及版本管理记录。
岗位要求
1、硕士学历,通信、微电子、计算机相关专业;
2、精通Verilog/VHDL硬件描述语言;
3、有Xilinx/Altera平台开发经验;
4、熟悉时序约束与仿真验证流程。
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岗位职责
1、负责FPGA逻辑架构设计、RTL编码、功能仿真与时序收敛;
2、优化逻辑资源利用率与关键路径时序,确保系统稳定可靠;
3、配合软硬件团队完成板级联调与系统集成验证;
4、输出FPGA设计文档、仿真报告及版本管理记录。
岗位要求
1、硕士学历,通信、微电子、计算机相关专业;
2、精通Verilog/VHDL硬件描述语言;
3、有Xilinx/Altera平台开发经验;
4、熟悉时序约束与仿真验证流程。
先核对岗位要求与自己的经历,再准备档案、投递和面试。