岗位描述
岗位职责:
1、floorplan布局规划,电源网络设计、时钟树综合分析、功耗面积优化分析;
2、timing closure、DRC/LVC、RC extraction等工作。
岗位要求:
1、硕士及以上学历,微电子相关专业;
2、具备时序分析和时序收敛的基本概念,熟悉Verilog语言;
3、扎实的数字电路基础;
4、具有较强的学习能力、沟通能力和良好的团队合作精神;
5、有以下研究方向或实践经验的优先考虑:了解可测试设计的基本概念,熟悉P&R流程,有tapeout的经验。
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岗位职责:
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2、timing closure、DRC/LVC、RC extraction等工作。
岗位要求:
1、硕士及以上学历,微电子相关专业;
2、具备时序分析和时序收敛的基本概念,熟悉Verilog语言;
3、扎实的数字电路基础;
4、具有较强的学习能力、沟通能力和良好的团队合作精神;
5、有以下研究方向或实践经验的优先考虑:了解可测试设计的基本概念,熟悉P&R流程,有tapeout的经验。
先核对岗位要求与自己的经历,再准备档案、投递和面试。